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功能

1.  单axi-stream 接口输入，axis输出。（10bit rbg输入，10bit rbg输出。）

 

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2. 使用xilinx hls 编写。

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2022/10/27 优化。

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 3. 配置寄存器有

 

	#pragma HLS INTERFACE s_axilite  port=matx    //ccm 参数
	#pragma HLS INTERFACE s_axilite port=width //宽 #pragma HLS INTERFACE s_axilite port=height //高

效果

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                                                    原图​编辑

                                             去掉 r 通道的图像

 扩展

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原文地址：http://www.cnblogs.com/alaode/p/16862422.html

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